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摘要
提出了几种分别采用两个锁存器和单个锁存器的三值双边沿触发器设计方案,这些方案包括动态、半静态和静态结构。双锁存器三值双边沿触发器是通过将两个透明的三值闩锁并列构成的。单个锁存器的三值双边沿触发器设计是通过时钟信号的上升沿及下降沿后分别产生的窄脉冲使锁存器瞬时导通完成取样求值。三值双边沿触发器具有对时钟信号的两个跳变均敏感的特点,因此可以抑制时钟信号的冗余跳变。较之三值单边沿触发器,在保持相同数据吞吐量的条件下,采用三值双边沿触发器可使时钟信号的频率减半,从而降低系统功耗。最后给出了采用0.25μmCMOS工艺参数的HSPICE模拟结果及其功耗比较。
- 出版日期2007-8-15
- 单位浙江大学
