遵循IEEE802.15.7可见光协议的设备应该支持两个强制模式PHY I和PHY II中的至少一个。基于FPGA的硬件结构特点,给出了符合IEEE802.15.7 PHY II模式的RS编码译码器的硬件算法及实现方式,在输入数据位宽固定的情况下,本编码译码器具有参数可变,工作速度高等特点,并且与系统中运行长度有限码有一定的搭配协调性,具有良好的纠错功能。
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